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集成电路/MK2049-02S
商品型号:MK2049-02S

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品牌:ICST
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  • 商品名称:MK2049-02S
  • 商品品牌:ICST
  • 商品类别:集成电路
  • 二级分类:集成电路
  • 商品型号:

    MK2049-02S

  • 封装规格:-
  • 商品编号:ACE184271585
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MK2049-02S中文资料
MK2049-02S中文资料第8页精选内容: MK2049-02 / 03通信时钟PLL MDS 2049-02 / 03 B 8修订版040601集成电路系统公司?525 RACE STREET?圣何塞?CA?95126?(408)295-9800TEL?WWW.ICST.COM PC板布局 =连接到VDD =连接到GND V G 1 16 2 3 4 15 14 13五 6 8 12 11 10 9 18 20帽抗.帽 G V 19 17 V帽抗.抗.帽布局和外部组件正确的电路板布局对成功使用MK2049至关重要.特别是CAP1和CAP2引脚对噪声和泄漏非常敏感(引脚18处的CAP2是最敏感的).痕迹必须尽可能短可能的,两个电容器和电阻器必须安装在设备旁边,如下所示.该显示在引脚15和17之间的电容以及引脚5和7之间的电容是电源去耦电容.引脚8和9上的高频输出时钟应具有33的串联终端 Ω靠近引脚连接.将所有组件都保持一致可能会带来额外的改进最小化通过其他信号层的过孔,并将其他信号从其他信号路由 MK2049.您也可以参考MAN05获取关于晶体部分布局的其他建议.晶体走线应该包括从X1和X2到地的小电容的焊盘;这些都习惯了调整电路板的杂散电容以匹配晶体负载电容.典型的电信参考频率精确到远低于1 PPM,因此即使在电路板上,MK2049也可以正确锁定和运行这些固定电容不会调整电容.但是,ICS MICROCLOCK建议包括调整电容器以最小化单个晶体中变化的影响,温度,和老化.对于给定的电路板布局,这些电容的值(通常为0-4 PF)使用标题为“确定晶体频率调整”一节中所述的程序电容器”. MK2049-02 / 03需要最少数量的外部元件才能正常工作.解耦必须在靠近芯片的VDD和GND引脚(特别是引脚4)之间连接0.01μF的电容和7,15和17)和33应在时钟输出端使用Ω终端电阻,其走线长度大于1英寸(假设50 Ω轨迹).图3.典型的MK2049-02 / 03布局 7帽帽 G可选的;见文本在地面和电源平面的抠图.
MK2049-02S关联型号
机译版中文资料(1/10) 英文原版数据手册(1/10)

*MK2049-02S中文资料的内容均为机器翻译结果,仅供参考

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