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集成电路/Z16C3010ASC00TR
商品型号:Z16C3010ASC00TR

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品牌:ZiLOG
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  • 商品名称:Z16C3010ASC00TR
  • 商品品牌:ZiLOG
  • 商品类别:集成电路
  • 二级分类:集成电路
  • 商品型号:

    Z16C3010ASC00TR

  • 封装规格:-
  • 商品编号:CYDOM185120181
  • 商品重量:0.000100kg
Z16C3010ASC00TR中文资料
Z16C3010ASC00TR中文资料第51页精选内容: DS007902-0708初步功能说明 Z16C30产品规格 47在USC中,IP位表示中断请求正在被服务.如果设置了IUS,全部在通道内和通道外部的较低优先级的中断源被预先处理,从请求中断中排出.内部中断源由状态禁止的内部菊花链,而较低优先级的设备被IEO输出抑制该通道被拉低并传播到后续外围设备.一个IUS位被设置在中断确认周期期间,如果没有更高优先级的设备请求中断.每个通道有6个中断源:接收状态,接收数据,发送状态“,”传输数据“,”I / O状态“和”设备状态“中按照该顺序优先化渠道.有六个接收状态中断源,每个单独使能:退出寻线,空闲线路,中断/中止,代码违规/发送结束/帧结束,奇偶校验错误和溢出错误.接收数据中断在接收时生成 FIFO充满超出接收中断控制寄存器中设定的电平的数据, (RICR).有六个传输状态中断源,每个单独启用:前导码发送空闲线路,中止发送,帧结束/发送结束,发送CRC,等等欠载错误.发送数据中断在发送FIFO时生成清空低于发送中断控制寄存器(TICR)中编程的电平. I / O状态中断用于报告六个引脚中的任何一个的转换.中断是通用的,在任一边或两边都有单独的选择,并且可以为每个引脚启用.引脚PRO-生成I / O状态中断的语法是RXC,TXC,RXREQ,TXREQ,DCD和 CTS.这些中断与引脚的编程功能无关.该器件状态中断有四个独立使能的源:接收字符计数FIFO溢出,获取DPLL同步,BRG1零计数和BRGO零计数.块传输模式 USC通过RXREQ,TXREQ, RXACK和TXACK引脚. RXREQ信号在充满液位时激活接收FIFO超出RICR中编程的值. DMA可以响应无论是正常的总线交易还是通过激活RXACK引脚直接读取数据 (飞转). TXREQ信号在发送的空电平时激活 FIFO低于TICR中编程的值. DMA可以用A响应正常的总线事务或通过激活TXACK引脚直接写入数据
Z16C3010ASC00TR关联型号
机译版中文资料(1/10) 英文原版数据手册(1/10)

*Z16C3010ASC00TR中文资料的内容均为机器翻译结果,仅供参考

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