TSB81BA3EIZAJ-TI(德州仪器)

    TSB81BA3E 提供了在基于电缆的 IEEE 1394 网络中实现三端口节点所需的数字和模拟收发器功能。每个电缆端口都包含两个差分线路收发器。收发器包括根据需要监控线路状况的电路，以确定连接状态、初始化和仲裁以及数据包接收和传输。

     TSB81BA3E 旨在与链路层控制器 (LLC) 连接，例如 TSB82AA2、TSB12LV21、TSB12LV26、TSB12LV32、TSB42AA4、TSB42AB4、TSB12LV01B 或 TSB12LV01C。它还可以连接电缆端口到电缆端口到集成的 1394 Link + PHY 层，例如 TSB43AB2。当 VREG_PD 端子（PFP 封装上的端子 73 和 ZAJ 封装上的端子 B7）连接到 GND 时，TSB81BA3E 可由单个 3.3V 电源供电。

     VREG_PD 启用内部 3.3-V 至 1.95-V 稳压器，为内核提供 1.95-V。当 VREG_PD 通过至少一个 1kΩ 电阻拉高至 VDD 时，TSB81BA3E 内部稳压器将关闭，并且该器件可由两个独立的外部稳压电源供电：I/O 为 3.3-V，内核为 1.95-V .内核电压提供给 PLLVDD-CORE 和 DVDD-CORE 端子，以满足推荐工作条件下的要求（标称 1.95V）。 PLLVDD-CORE 端子必须与 DVDD-CORE 端子分开。

     PLLVDD-CORE 和 DVDD-CORE 端子必须用 1 uF 电容去耦以稳定各自的电源。也可以使用额外的 0.10 mF 和 0.01 mF 高频旁路电容器。 DVDD-CORE 和 PLLVDD-CORE 之间的分离可以通过单独的电源轨实现，也可以通过单个电源轨实现，其中 DVDD-CORE 和 PLLVDD-CORE 由滤波器网络隔开以防止来自 PLLVDD-CORE 的噪声供应。

     TSB81BA3E 需要一个外部 98.304-MHz 晶体振荡器来生成参考时钟。外部时钟驱动一个内部锁相环 (PLL)，它生成所需的参考信号。该参考信号提供控制出站编码信息传输的时钟信号。

    一个 49.152-MHz 时钟信号被提供给相关的 LLC 以同步两个设备，并在按照 IEEE 1394a-2000 标准操作 PHY-link 接口时用于接收数据的重新同步。当按照 IEEE P1394b 标准运行 PHY-link 接口时，向关联的 LLC 提供 98.304 MHz 时钟信号以同步两个设备。断电 (PD) 功能在通过将 PD 端置为高电平来启用时，会停止 PLL 的操作。

	型号：TSB81BA3EIPFP 品牌：TI(德州仪器) 封装：80-HTQFP（12x12）产品状态：在售	查看详情
	型号：TSB81BA3EPFP 品牌：TI(德州仪器) 封装：80-HTQFP（12x12）产品状态：在售	查看详情
	型号：TSB81BA3EZAJ 品牌：TI(德州仪器) 封装：168-NFBGA（7x7）产品状态：在售	查看详情

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	商品分类	收发器
	品牌	TI(德州仪器)
	封装	168-NFBGA（7x7）
	包装	整包装
	类型	收发器
	协议	IEEE1394
	驱动器/接收器数	6/6
	双工	半
	数据速率	-
	电压-供电	3V~3.6V
	工作温度	-40℃~85℃
	基本产品编号	TSB81BA3E
	HTSUS	8542.39.0001
	ECCN	EAR99
	REACH状态	非REACH产品
	湿气敏感性等级(MSL)	3（168小时）
	RoHS状态	符合ROHS3规范
	安装类型	表面贴装型

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