LMK04832-SEP系列介绍资料

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LMK04832-SEP

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产品详情

LMK04832-SEP 是一款适用于航天应用、支持 JEDEC JESD204B/C 的高性能时钟调节器。

PLL2 可以配置 14 个时钟输出以驱动 7 个 JESD204B/C 转换器或其他逻辑器件（使用器件和 SYSREF 时钟）。SYSREF 可以通过直流和交流耦合提供。14 个输出中的每一个输出都可以单独配置为用于传统时钟系统的高性能输出（不限于 JESD204B/C 应用）。

无论有无 SYSREF 生成或重新计时，该器件都可以配置为在双 PLL、单 PLL 或时钟分配模式下运行。PLL2 可以使用内部或外部 VCO 工作。

高性能与多种特性（如功耗和性能权衡调节、双 VCO、动态数字延迟和保持）相结合，可提供灵活的高性能时钟树。

VID#：V62/22612
- 电离辐射总剂量 30krad（无 ELDRS）
- SEL 抗扰度 > 43MeV × cm²/mg
- SEFI 抗扰度 > 43MeV × cm²/mg
环境温度范围：-55°C 至 125°C
最高时钟输出频率：3255MHz
多模式：双 PLL、单 PLL 和时钟分配
6GHz 外部 VCO 或分配输入
超低噪声（2500MHz 时）：
- 54fs RMS 抖动（12kHz 至 20MHz）
- 64fs RMS 抖动（100Hz 至 20MHz）
- –157.6dBc/Hz 本底噪声
超低噪声（3200MHz 时）：
- 61fs RMS 抖动（12kHz 至 20MHz）
- 67fs RMS 抖动（100Hz 至 100MHz）
- –156.5dBc/Hz 本底噪声
PLL2
- –230dBc/Hz PLL FOM
- –128dBc/Hz PLL 1/f
- 相位检测器频率高达 320MHz
- 两个集成 VCO：2440MHz 至 2600MHz 和 2945MHz 至 3255MHz
多达 14 个差分器件时钟
- CML、LVPECL、LCPECL、HSDS、LVDS 和 2xLVCMOS 可编程输出
最多 1 个缓冲 VCXO/XO 输出
- LVPECL、LVDS、2xLVCMOS 可编程输出
1-1023 CLKOUT 分频器
1-8191 SYSREF 分频器
SYSREF 时钟 25ps 阶跃模拟延迟
器件时钟和 SYSREF 数字延迟和动态数字延迟
PLL1 保持模式
PLL1 或 PLL2 0 延迟
高可靠性
- 受控基线
- 一个组装/测试场所
- 一个制造场所
- 延长的产品生命周期
- 延长的产品变更通知
- 产品可追溯性

Function	Dual-loop PLL, Ultra-low jitter clock generator
Number of outputs	15
RMS jitter (fs)	54
Output frequency (max) (MHz)	3255
Input type	HCSL, LVCMOS, LVCMOS (REF_CLK), LVDS, LVPECL, LVPECL (VCXO_CLK)
Output type	CML, HSDS, LVCMOS, LVDS, LVPECL
Supply voltage (min) (V)	3.135
Supply voltage (max) (V)	3.465
Features	0 Delay, Integrated VCO, JESD204B, Loss of signal detection, Manual/auto switch, Programmable Delay, SPI
Rating	Space
Operating temperature range (°C)	-55 to 125
Number of input channels	3

HTQFP (PAP)

144 mm² 12 x 12

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