SN65LVDS302 接收器将与 FlatLink™3G 兼容的串行输入数据解串为 27 个并行数据输出。SN65LVDS302 接收器包含一个移位寄存器，在检查奇偶校验位之后，此寄存器从 1、2 或 3 个串行输入载入 30 位，并且将 24 个像素位和 3 个控制位锁存至并行 CMOS 输出。如果奇偶校验确认奇偶校验正确，通道奇偶校验错误 (CPE) 输出保持低电平。如果检测到奇偶校验错误，CPE 输出生成一个高脉冲，而数据输出总线忽略刚刚接收到的像素。或者，最后一个数据字在下一个时钟周期内被保持在输出总线上。
| Function | Deserializer |
| Protocols | Channel-Link I |
| Supply voltage (V) | 1.8 |
| Signaling rate (MBits) | 1755 |
| Input signal | LVDS |
| Output signal | CMOS |
| Rating | Catalog |
| Operating temperature range (°C) | -40 to 85 |
| NFBGA (ZXH) | 80 | 25 mm² 5 x 5 |
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