This dual negative-edge-triggered J-K flip-flop is designed for 1.65-V to 3.6-V VCC operation.
| Number of channels | 2 |
| Technology family | LVC |
| Supply voltage (min) (V) | 2 |
| Supply voltage (max) (V) | 3.6 |
| Input type | TTL/CMOS |
| Output type | Push-Pull |
| Clock frequency (MHz) | 150 |
| Supply current (max) (µA) | 10 |
| IOL (max) (mA) | 24 |
| IOH (max) (mA) | -24 |
| Features | Balanced outputs, Clear, Negative edge triggered, Over-voltage tolerant inputs, Preset, Very high speed (tpd 5-10ns) |
| Operating temperature range (°C) | -40 to 125 |
| Rating | Catalog |
| SOIC (D) | 16 | 59.4 mm² 9.9 x 6 |
| SOP (NS) | 16 | 79.56 mm² 10.2 x 7.8 |
| SSOP (DB) | 16 | 48.36 mm² 6.2 x 7.8 |
| TSSOP (PW) | 16 | 32 mm² 5 x 6.4 |
| TVSOP (DGV) | 16 | 23.04 mm² 3.6 x 6.4 |
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