Microchip微芯 ZL30101 产品介绍
2026-04-14
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说明
ZL30101 Stratum 3系统同步器包含一个数字锁相环(DPLL),为多中继T1和E1传输设备提供定时和同步。
ZL30101生成ST-BUS和其他TDM时钟和成帧信号,这些信号被锁相到两个输入基准中的一个。它通过监测其参考的准确性和稳定性,以及在参考切换操作期间和参考不可用的短时间内保持稳定的输出时钟,有助于确保系统的可靠性。
ZL30101旨在成为符合Telcordia、ETSI、ITU-T和ANSI网络规范的网络设备的中央定时和同步资源。
特性
- 支撑Telcordia GR-1244-CORE Stratum 3
- 支持G.823和G.824的2048 kbps和1544 kbps接口
- 支持ISDN主速率接口的ANSI T1.403和ETSI ETS 300 011
- 简单的硬件控制接口
- 接受两个输入参考,并与8 kHz、1.544 MHz、2.048 MHz、8.192 MHz或16.384 MHz输入的任何组合同步
- 提供一系列时钟输出:1.544 MHz、2.048 MHz、16.384 MHz以及4.096 MHz和8.192 MHz或32.768 MHz和65.536 MHz
- 提供5种8 kHz成帧脉冲
- 保持频率精度为1 x 10-8
- 锁定、保持和超出范围指示
- 1.8 Hz或922 Hz的可选环路滤波器带宽
- 所有输出时钟上的抖动小于0.5 nspp
- 外部主时钟源:时钟振荡器或晶体
参数
类型 | 描述 |
Type | General Purpose |
Inputs | 2 |
CMOS Outputs | 5 |
Low-Jitter Synthesizers | 0 |
Typical Jitter (12kHz-20MHz) fs RMS | PDH Interfaces |
Diff InputFreq. Range | 8 kHz, 1.544 MHz, 2.048 MHz, 8.192 MHz or 16.384 MHz |
Output Freq Range | 65.536 MHz |



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