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MAX5868

不推荐用于新设计

16位、5Gsps内插和调制RF DAC 支持DC至2GHz以上频率的500MHz瞬时带宽的直接RF合成

ADI亚德诺 MAX5868 产品介绍
2026-03-09 0次

特性


  • 通信应用中的直接RF合成解决方案
    • DAC输出更新速率:4.96Gsps
    • 高性能14位射频DAC内核
    • 具有1Hz/10Hz/100Hz/1kHz/10kHz分辨率的数字正交调制器和NCO
    • 4x/5x/6x/8x/10x/12x/16x/20x/24x插值
    • 16位1240Mwps DDR并行LVDS数据总线
  • 高度灵活且可配置
    • 具有字、字节和半字节模式的数据总线
    • FPGA接口的参考时钟输出
    • 多DAC同步
    • 用于器件配置的SPI接口
  • 低功耗、紧凑型解决方案
    • fCLK = 5Gsps时为1.5W
    • 10mm x 10mm、144引脚CSBGA封装

产品详情和应用


MAX5868是一款高性能、16位、5Gsps、内插和调制RF DAC,可直接合成DC至2GHz以上频率高达500MHz的瞬时带宽。该器件针对有线和数字视频广播应用进行了优化,满足EPoC、DVB-T、DVB-T2、DVB-C2、ISDB-T和DOCSIS 3.0/3.1等一系列通信标准的频谱屏蔽要求。

该器件集成了插值滤波器、数字正交调制器、数控振荡器(NCO)和14位RF DAC内核。4x、5x、6x、8x、10x、12x、16x、20x或24x线性相位插值滤波器由用户进行配置,可降低FPGA/ASIC所需的输入数据带宽。NCO支持对输入基带信号进行全捷变调制,以实现直接RF合成。

MAX5868包括一个源同步16位并行LVDS数据输入接口。输入基带I和Q信号在单个并行输入端口上时间交错,配置为双倍数据速率时钟,高达1240Gwps(I和Q各为620Mwps)。该器件支持字(16位)、字节(8位)或半字节(4位)模式的数据。输入数据与数据提供的数据时钟对齐。输入FIFO将输入接口的时序与DAC更新时钟域分离。此外,可利用奇偶校验输入和奇偶校验标志中断输出确保数据完整性。

MAX5868时钟输入具有灵活的时钟接口,接受差分正弦波或方波输入时钟信号。该器件输出分频参考时钟,确保与驱动其输入端口的FPGA/ASIC同步。此外,还提供专用输入和输出信号以同步多个器件。

MAX5868采用差分电流导引架构,可在50Ω负载下产生0dBm满量程输出信号电平。该器件采用1.8V和1.0V电源供电,5Gsps下功耗为1.5W。该器件采用紧凑型144引脚CSBGA封装,额定温度范围为-40°C至+85°C扩展温度范围。

应用

  • 数字视频广播
  • 下行DOCSIS CMTS调制器
  • DVB-T/DVB-T2/DVB-C2/ISDB-T调制器
  • 同轴电缆以太网PON (EPoC)
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