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AD9517-3

推荐用于新设计

12路输出时钟发生器,集成2.0 GHz VCO

ADI亚德诺 AD9517-3 产品介绍
2026-03-09 0次

特性


  • 低相位噪声锁相环(PLL)
    • 片内VCO的调谐频率范围为1.75 GHz至2.25 GHz
    • 可选外部VCO/VCXO,最高达2.4 GHz
    • 1路差分或2路单端参考输入
      参考监控功能
    • 自动恢复和手动参考
      • 切换/保持模式
    • 支持最高250 MHz的LVPECL、LVDS或CMOS基准
      可编程PFD路径延迟
    • 可选数字或模拟锁定检测
  • 上电时所有输出自动同步
  • 提供手动输出同步
  • 采用48引脚LFCSP封装
  • 2对1.6 GHz LVPECL输出
    • 每对输出共用1至32分频器和粗调相位延迟
    • 加性输出抖动:225 fs均方根值
    • 通道间偏斜成对输出小于10 ps
  • 2对800 MHz LVDS时钟输出
    • 每对输出共用两个1至32级联分频器和粗调相位延迟
    • 加性输出抖动:275 fs均方根值
    • 可以精调每路LVDS输出的延迟(Δt)
    • 可以将每路LVDS输出重新配置为两路250MHz CMOS输出

产品详情和应用


AD9517-31提供多路输出时钟分配功能,具有亚皮秒级抖动性能,并且片内集成锁相环(PLL)和电压控制振荡器(VCO)。片内VCO的调谐频率范围为1.75 GHz至2.25 GHz。也可以使用高达2.4 GHz的外部VCO/VCXO。

AD9517-3具有出色的低抖动和相位噪声特性,可极大地提升数据转换器的性能,并且也有利于其它相位噪声和抖动要求严苛的应用。

AD9517-3具有四路LVPECL输出(分为两对)和四路LVDS输出(分为两对)。可以将每路LVDS输出重新配置为两路CMOS输出。LVPECL输出的工作频率达1.6 GHz,LVDS输出的工作频率达800 MHz,CMOS输出的工作频率达250 MHz。

对于需要附加输出,晶振基准输入,零延迟或EEPROM以便在启动时自动配置的应用,可以使用AD9520和AD9522。 此外,AD9516和AD9518与AD9517相似,但输出组合不同。

每对输出均有分频器,其分频比和粗调延迟(或相位)均可以设置。LVPECL输出的分频范围为1至32。LVDS/CMOS输出的分频范围最高可达1024。

AD9517-3提供48引脚LFCSP封装,可以采用3.3 V单电源供电。采用外部VCO时,需要更宽的电压范围, 可通过将电荷泵电源(VCP)与5.5 V电压相连来实现。独立的LVPECL电源可以为2.5 V至3.3 V(标称值)。

AD9517-3的额定工作温度范围为−40°C至+85°C标准工业温度范围。

应用

  • 低抖动、低相位噪声时钟分配
  • 10/40/100 Gb/s网络线路卡,包括SONET、同步以太网、OTU2/3/4
  • 前向纠错(G.710)
  • 为高速ADC、DAC、DDS、DDC、DUC、MxFE提供时钟
  • 高性能无线收发器
  • 自动测试设备(ATE)和高性能仪器仪表

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